Pregunta 4.a-b - División de frecuencia y generad… · Fonaments dels Computadors UAB 2023
Tema: Registros, contadores y memorias: detección y generación de secuencias · Del examen Examen Parcial de Fundamentos de Computadores - Bloque 2 (2023)
Enunciado
Pregunta 4. Cuestiones sobre división de frecuencia, generadores de secuencias y parámetros temporales
a.
Se requiere obtener una señal de reloj con una frecuencia de 200 MHz disponiendo de una señal de reloj de entrada de 1600 MHz. Explica el fundamento teórico y la propuesta de diseño detallando la señal de entrada, el módulo empleado y la toma de la señal generada. [3 puntos]
b.
Razona la validez de la siguiente afirmación: «Para diseñar un circuito generador de una secuencia cíclica formada por 6 dígitos hexadecimales, se pueden emplear 4 registros de desplazamiento de 6 bits combinados con puertas AND». Explica cómo debe estructurarse correctamente este tipo de generadores finitos de secuencias. [3,5 puntos]

Solución
Según los criterios oficiales de corrección
a. Se requiere obtener una señal de reloj con una frecuencia de 200 MHz disponiendo de una señal de reloj de entrada de 1600 MHz. Explica el fundamento teórico y la propuesta de diseño detallando la señal de entrada, el módulo empleado y la toma de la señal generada.
Solución: Factor de división . Se emplea un contador síncrono binario de bits () de módulo 8 (de 0 a 7), conectando el reloj base de 1600 MHz a su entrada . La salida de bit más significativo proporciona una señal de frecuencia con ciclo de trabajo del 50%.
b. Razona la validez de la siguiente afirmación: «Para diseñar un circuito generador de una secuencia cíclica formada por 6 dígitos hexadecimales, se pueden emplear 4 registros de desplazamiento de 6 bits combinados con puertas AND». Explica cómo debe estructurarse correctamente este tipo de generadores finitos de secuencias.
Solución: La afirmación es FALSA. La estructura correcta consiste en un contador binario de 3 bits con recorte de ciclo a 6 estados mediante la señal síncrona de carga (load) y un bloque de lógica combinacional que decodifique cada estado a las 4 líneas binarias del dígito hexadecimal correspondiente.
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