Ejercicio 4 · Introducció als Computadors UPC 2013
Tema: Circuits seqüencials: anàlisi · Del examen Examen 2 (8 de abril de 2013) (2013)
Enunciado
Ejercicio 4 (1,5 puntos). Circuito secuencial simple con análisis temporal de retardos
Dado el esquema lógico del circuito secuencial de la figura, sabiendo que los retardos de propagación de los elementos son:
Puerta NOT:
Puerta XOR: (se asume que nunca genera pulsos espurios o glitches)
Biestable:
a)
Dibujar el grafo de estados correspondiente y especificar la leyenda utilizada (0,5 puntos).
b)
Completar el cronograma detallado de las señales , y en la cuadrícula temporal provista (1 punto):

Solución
Según los criterios oficiales de corrección
Ejercicio 4. Circuito secuencial simple con análisis temporal de retardos (grafo de estados y cronograma)
Solución: a. Ecuaciones y grafo de estados: - Ecuación de estado siguiente: . - Ecuación de la salida: (máquina de Moore). - Comportamiento: - Si : . Con ; con . - Si : . Con ; con . - Leyenda: Cada nodo contiene . El arco con valor indica la condición de transición. b. Cronograma detallado: - Inicialmente hasta hay un periodo de inicialización o valor desconocido; en la señal de estado toma . - : mientras , ; cuando pasa a 1, cae a 0 tras . - Flanco activo de subida en : con antes del flanco, conmuta a 1 a partir de . - Flanco en : se mantiene en 1 (pues ). - En : con , pasa a 0 en (y pasa a 1 en ). - La señal responde a las variaciones de con retardo de (reacción de la XOR) y a las de con retardo de .
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