Ejercicio 5 - Diseño de PPE · Introducció als Computadors UPC Examen 2 (temas 4, 5, 6 y 7)
Tema: Processadors de propòsit específic i handshaking · Del examen Examen 2 (temas 4, 5, 6 y 7)
Enunciado
Ejercicio 5. Diseño de procesador de propósito específico (PPE)
Se desea completar el diseño de un procesador de propósito específico (PPE) que, a partir de una secuencia de entrada para , calcula la secuencia de salida (para enteros en complemento a dos):
Considerad que los valores previos y valen 0.
El PPE se comunica con el circuito emisor del dato mediante un protocolo asíncrono de handshaking de 4 fases: la unidad de control (UC) recibe la señal del emisor y genera hacia él la señal .
Hacia el circuito receptor, el PPE envía cada dato mediante un protocolo síncrono, activando la señal durante un único ciclo en el que debe estar presente en el bus . El PPE y el receptor comparten la misma señal de reloj.
El esquema de la unidad de procesamiento (UP) se muestra a continuación (los registros R1 y R2 tienen estado inicial 0):
a.
Escribid la etiqueta y el nombre del bloque estándar combinacional utilizado en cada una de las posiciones B1, B2 y B3 de la UP. ( Recordad que multiplicar por 0,5 equivale a dividir entre 2, y por 0,25 equivale a dividir entre 4).
b.
Completad el grafo de estados de la UC del PPE (con su leyenda) y la tabla de salidas correspondiente (asignando los valores a las señales ). Dibujad el grafo y la tabla en papel:
c.
Si la UC se implementa con el número mínimo de biestables y dos memorias ROM (una para el estado siguiente y otra para las salidas), indicad cuántas palabras y de cuántos bits por palabra debe tener cada una de las memorias.

Solución
Según los criterios oficiales de corrección
a. Bloque combinacional B1 de la UP:
Solución: SRA-2
a. Bloque combinacional B2 de la UP:
Solución: SRA-2
a. Bloque combinacional B3 de la UP:
Solución: SRA-1
b. Completad el grafo de estados de la UC del PPE (con su leyenda) y la tabla de salidas correspondiente (asignando los valores a las señales Ack, Ld1, Ld2, LdW, Vw).
Solución: Grafo de 4 estados con protocolo de 4 fases para Req/Ack y pulso de 1 ciclo en Vw: - S0: espera petición (Req=0 -> S0; Req=1 -> S1). Salidas: Ack=0, Ld1=0, Ld2=0, LdW=x, Vw=0. - S1: cálculo y carga en registros (transición incondicional a S2). Salidas: Ack=0, Ld1=1, Ld2=1, LdW=1, Vw=0. - S2: validación síncrona del resultado (transición incondicional a S3). Salidas: Ack=0, Ld1=0, Ld2=0, LdW=x, Vw=1. - S3: confirmación asíncrona de 4 fases (Req=1 -> S3; Req=0 -> S0). Salidas: Ack=1, Ld1=0, Ld2=0, LdW=x, Vw=0.
c. ROM de estado siguiente: número de palabras:
Solución: 8
c. ROM de estado siguiente: bits por palabra:
Solución: 2
c. ROM de salidas: número de palabras:
Solución: 4
c. ROM de salidas: bits por palabra:
Solución: 5
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